DSP56311EVM【PDF 189/360 页】KIT EVALUATION FOR DSP56311

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SCI After Reset

causing the SCI Status Register (SSR) to be reset. No other SCI registers are affected by

the STOP instruction.

Table 8-1 illustrates how each type of reset affects each register in the SCI.

Table 8-1. SCI Registers After Reset

Reset Type

Register

Bit Mnemonic

Bit Number

HW Reset

SW Reset

IR Reset

ST Reset

SCR

REIE 16 0

SCKP 15 0

STIR 14 0

TMIE 13 0

TIE 12 0

RIE 11 0

ILIE 10 0

TE 9 0

RE 8 0

WOMS 7 0

RWU 6 0

WAKE 5 0

SBK 4 0

SSFTD 3 0

WDS[2–0] 2–0 0

0

0

0

0

0

0

0

0

0

0

0

0

0

0

0

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

SSR R8

FE

PE

OR

IDLE

RDRF

TDRE

TRNE

7

6

5

4

3

2

1

0

0

0

0

0

0

0

1

1

0

0

0

0

0

0

1

1

0

0

0

0

0

0

1

1

0

0

0

0

0

0

1

1

TCM 15 0

RCM 14 0

SCCR SCP 13 0

COD 12 0

CD[11–0] 11–0 0

SRX SRX[23–0] 23–16, 15–8, 7–0 —

STX STX[23–0] 23–0 —

SRSH SRS[8–0] 8–0 —

STSH STS[8–0] 8–0 —

0

0

0

0

0

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

–

SRSH SCI receive shift register, STSH—SCI transmit shift registe r

HW Hardware reset is caused by asserting the external RESET signal.

SW Software reset is caused by executing the RESET instruction.

IR Individual reset is caused by clearing PCRE (bits 0–2) (configured for GPIO).

ST Stop reset is caused by executing the STOP instruction.

1 The bit is set during this reset.

0 The bit is cleared during this reset.

—

The bit is not changed during this reset.

DSP56311 User’s Manual, Rev. 2

Freescale Semiconductor

8-5

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